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Nalamala V.

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Hi, myself Venkatesh. I have a 1 year and 7 months of experience as a rtl design engineer. And i am having a skills of verilog abd vhdl. I am worked on a AXI protocol interface.
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Expérience

RTL design engineer

Apollo computing laboratories
déc. 2020 - Jusqu'à présent
Hi, myself Venkatesh. I have a 1 year and 7 months of experience as a rtl design engineer. And i am having a skills of verilog abd vhdl. I am worked on a AXI protocol interface.

Éducation

Btech/be

Jawaharlal Nehru Technological University, India 2014 - 2017
(3 ans)

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